聯華電子與益華電腦 (Cadence) 今日 (19日) 共同宣佈，雙方已經針對日趨複雜的混合信號設計，合作推出類比參考流程。益華電腦 Virtuoso 平台參考流程已通過聯華電子 0.18 微米混合信號 CMOS 製程驗證。

聯華電子與益華電腦已針對聯華電子 0.18 微米混合訊號 CMOS 製程技術，發展出製程設計套件 (PDK)。雙方將針對聯華電子不同製程技術持續發展，致力於建立理想的矽晶設計流程以降低雙方客戶從設計到量產時的風險。此最新的 0.18 微米混合信號設計套件，可簡化在混合信號設計時日漸提昇的複雜性。

聯華電子設計支援部部長劉康懋表示，“聯華電子與益華電腦的客戶皆可受惠於類比參考流程與最新 0.18 微米 MM 製程設計套件，以縮短設計生產週期並加強設計首次即可成功的保證。我們很高興與益華電腦合作，藉由其 Virtuoso 設計平台經過驗證的參考流程，以因應現今複雜混合信號設計上的挑戰。”

消費性電子產品以及無線科技的日新月異，促進了混合信號設計的發展。根據估計在 2005 年，系統單晶片上混合信號的總內容將到達 70% 以上。隨著持續提高的複雜性，以共同合作方式，製造經過矽晶實體驗證的參考流程與製程設計套件，更顯得格外重要，藉此將可簡化設計上的挑戰。結合了此共同開發的製程設計套件，益華電腦類比 / 混合信號解決方案，以及聯華電子先進製程技術，可使混合信號晶片設計者在單一晶片上整合更多功能。

“隨著混合信號設計的市場潛能增加，研發製程設計套件並建立通過驗證的參考流程是十分重要的，如此才能減低將導致喪失市場先機且耗費成本的重複修改風險” 益華電腦企業發展部副總經理 Charlie Huang 說。 “聯華電子製程技術與我們領先業界的 Virtuoso 平台類比與混合信號設計解決方案之結合，可確保我們客戶擁有經過驗證的最佳解決方案。”

此參考流程使用益華電腦 Virtuoso 平台與工具，以針對類比與混合信號設計提供完善解決方案。 此 Virtuoso 平台是全球第一個針對快速、經過矽晶實體驗證、類比與混合信號設計的平台。 聯華電子類比參考流程包含了以下益華電腦技術：Virtuoso Schematic Editor for schematic capture, Virtuoso XL Layout Editor, Virtuoso Spectre Circuit Simulator, AssuraTM Design Rule Checker (DRC) and Assura Layout vs. Schematic Verifier (LVS) for physical verification, Assura Parasitic Extractor (RCX), and Virtuoso Analog Design Environment for front-to-back analog design automation for full-custom analog IC design.

0.18 微米 MM 製程設計套件，是聯華電子與益華電腦長期協議共同開發之設計套件的其中一項，以協助整合聯華電子製程技術與益華電腦全面類比與混合信號晶片設計與驗證流程。提供客戶在研發先進混合信號系統單晶片時，於設計至製造的過程中取得時效與市場先機。

此製程設計套件針對自動化設計流程與 DRC 參數化校正電路，在自動產生元件的應用方面，提供了 Symbol 資料庫和技術文件。這些製程設計套件 (PDK) 在益華的 RF / 類比混合訊化解決方案，已經通過了 Virtuoso Spectre 模型的認證

目前益華電腦與聯華電子客戶可經由聯華電子業務代表或是透過 MyUMC 網站 (my.umc.com), 免費使用聯華電子的類比參考流程套件與 0.18 微米 MM 製程設計套件。您可以由 http://www.umc.com/English/pdf/design_datasheet_0402_03.pdf 獲得更多類比參考流程的相關資料。

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